A Secure Software Pattern Generation with Design Level Information
보안공학연구지원센터(JSE) 보안공학연구논문지 Vol.7 No.6 2010.12 pp.645-655
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소프트웨어 검사방법을 이용한 VHDL 설계에서의 테스트 패턴 생성
[Kisti 연계] 대한전자공학회 대한전자공학회 학술대회논문집 1998 pp.1065-1068
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